[X]关闭

[米联客-XILINX-H3_CZ08_7100] FPGA_PCIE通信(linux)连载-08PCIE数据卡DDR缓存中断

文档创建者:FPGA课程
浏览次数:202
最后更新:2024-09-19
文档课程分类-AMD-ZYNQ
AMD-ZYNQ: ZYNQ-FPGA部分 » 2_FPGA实验篇(仅旗舰) » 7-FPGA PCIE通信(Linux)
本帖最后由 FPGA课程 于 2024-9-19 08:59 编辑

​ 软件版本:VIVADO2021.1
操作系统:WIN10 64bit
硬件平台:适用 XILINX A7/K7/Z7/ZU/KU 系列 FPGA
实验平台:米联客-MLK-H3-CZ08-7100开发板
板卡获取平台:https://milianke.tmall.com/
登录“米联客”FPGA社区 http://www.uisrc.com 视频课程、答疑解惑!



1概述
上一个例子演示了用BRAM作为数据缓存,显然板卡的BRAM容量非常有限,如果需要更大量数据的缓存就得用到DDR作为缓存。本方案实现的功能和上一篇文章中BRAM缓存的方式一样。使用DDR缓存具有更多的应用场景,比如视频图像的缓存等。本方案中也用到了XMDA的中断方式采集数据。
2系统框图
本系统中通过Milianke Uispi7606 IP串行采集数据,通过Milianke uifdma_dbuf将数据写入DDR。PCIE上位机使用XDMA IP通过AXI Interconnect IP读取存放在DDR中的SPI数据。
eb88ae1f2345463b8cd1f5e72b852bc4.jpg
3FPGA工程
c2ed8bc2018e43de9c60e3c5108cbfe1.jpg
新版本的DAQ7606只支持SPI串行采样源码封装成uispi7606 IPCORE,教程的第一部分课程中有详细的讲解分析。采用SPI接口可以省下更多的FPGA IO。
        以上demo种主要使用到了米联客开发的2个IP分别为uifdma_dbuf数据缓存控制IP以及uiFDMA 基于AXI的DMA IP,关于更多这两个IP的详细介绍可以阅读相关章节,也可以在线阅读我们官方的技术博文关于AXI4-总线篇种相关内容AXI4总线入门(2021) - UISRC工程师学习站 - Powered by uisrc.com!
4上位机程序设计
681eaabd490c4b0eb31d07d2c24c64dd.jpg
5硬件安装
注意先下载程序,调试阶段下载bit文件,然后再开电脑。这样才能正确识别和后续测试工作正常开展。这里需要使用到DAQ001数据采集卡。
d744263fcd134801a0ed4f8cceccc3c1.jpg
利用波形发生器提供测试波形
43bfff6f412149968e7b005c72b39117.jpg

6实验结果
上位机代码比较简单,可以自己阅读。下面给出测试结果。
0311f6fb684042d381319bf51fff832b.jpg


您需要登录后才可以回帖 登录 | 立即注册

本版积分规则