问答 店铺
热搜: ZYNQ FPGA discuz

QQ登录

只需一步,快速开始

微信登录

微信扫码,快速开始

微信扫一扫 分享朋友圈

已有 4844 人浏览分享

开启左侧

AXIS to video out IP核仿真问题

[复制链接]
4844 0
本帖最后由 没落骑士 于 2020-4-6 19:22 编辑

为了理解ZYNQ显示通路的相关IP核使用方式,在VIVADO的BD中搭建如下电路:
Video in to AXIS -->AXIS to video out。
video in to AXIS和VTC IP核均正常工作,并且AXIS to video out IP的aresetn和vid_io_out_reset均给出了一段时间的有效复位。但是AXIS to video out IP一直没有输出数据。仿真波形如下:
局部放大:

时钟复位信号:

请问可能是什么原因导致AXIS to video out一直没有输出,且lock始终为0??


本帖子中包含更多资源

您需要 登录 才可以下载或查看,没有账号?立即注册

×
您需要登录后才可以回帖 登录 | 立即注册

本版积分规则

精彩推荐
热门资讯
网友晒图
图文推荐

  • 微信公众平台

  • 扫描访问手机版