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cadence学习记录

 火.. [复制链接]
63984 32
一般差分线在出线、拐角、换层的地方容易产生长度误差,因此匹配长度的时候,尽量选择在这些点进行走线长度补偿:1、在差分线的两端换层过孔处进进行匹配
2、在差分线的两端通过绕小波进行走线匹配
3、在差分线两端通过绕大波进行匹配。
高速差分线除了长度需要控制之外,还需要注意所有信号必须要有一个完整的参考平面,最好是地平面。在低频差分线布线中,有时可以使差分线跨分割,或者通过过孔换到其他层面,因为差分线中的电磁波能量大部分被控制在耦合差分对之间,参考平面的转换对其性能影响不是很大。

评论 32

yangtong  新手上路  发表于 2019-7-2 10:16:44 | 显示全部楼层
EMMC 数据线与CMD CLK做等长
yangtong  新手上路  发表于 2019-7-3 16:52:18 | 显示全部楼层
EMMC中RFU悬空不接
yangtong  新手上路  发表于 2019-7-3 17:09:35 | 显示全部楼层
EMMC的RST管脚不接FPGA,直接上拉
yangtong  新手上路  发表于 2019-7-6 11:47:14 | 显示全部楼层
can芯片的RXT,TXD 直接连接MCU,CANH,CANL接120R匹配电阻走差分等长线,保持走线距离尽量短
yangtong  新手上路  发表于 2019-7-6 15:03:06 | 显示全部楼层
RS485单点共地,AB为差分信号
yangtong  新手上路  发表于 2019-7-9 15:00:45 | 显示全部楼层
M2 分为socket2,和socket3
yangtong  新手上路  发表于 2019-7-9 15:01:46 | 显示全部楼层
通常SATA的插槽只能走SATA3的通道,而M.2的插槽分为Socket 2跟Socket 3

M.2(Socket 2)的固态可以走SATA3或者PCI-E 3.0×2通道(就是两条PCI-E),而M.2(Socket 3)的固态则可以走PCI-E 3.0×4通道

需要说的是每条PCI-E 3.0的带宽是8Gbps,而SATA 3.0的带宽则只有6Gbps
yangtong  新手上路  发表于 2019-7-9 15:15:13 | 显示全部楼层
AHIC是针对SATA这种弯路的交通规则,然后开发者发现,这种针对弯路的规范,数据只能一个一个通过的规则用在宽敞的PCIE通道上面实在太浪费了,于是针对PCIE通道又开发出了NVME规范,可以让很多数据同时通过

总结:M.2跟SATA其实可以说是插槽的形状,而PCI-E跟SATA3就是数据从硬盘到CPU或者内存走的通道,而NVME跟AHCI就是针对PCI-E跟SATA通道的“交通规则”
yangtong  新手上路  发表于 2019-7-9 16:54:12 | 显示全部楼层
图文解说:m2连接器的定义(不全)http://nga.178.com/read.php?tid= ... page=1&rand=294
yangtong  新手上路  发表于 2019-7-10 14:08:04 | 显示全部楼层
http://m.elecfans.com/article/657381.html 还没实际操作过,可行性感觉不高,实在不行在转,转完需要核对
yangtong  新手上路  发表于 2019-7-11 17:04:56 | 显示全部楼层
PCIE管脚为高速专用管脚与fpga相连接时不需要电平转换
yangtong  新手上路  发表于 2019-7-12 16:05:34 | 显示全部楼层
投板时若需要制作椭圆孔或者矩形孔需要额外制作NC route 否则板厂不识别椭圆孔
yangtong  新手上路  发表于 2019-7-15 10:02:10 | 显示全部楼层
本帖最后由 yangtong 于 2019-7-15 10:06 编辑

M2连接器制作封装时可以将管脚补全兼容b&M;
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