FDMA1.1版本AXI4 DMA支持多路同时读写PS或者PLDDR

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FDMA1.1版本AXI4 DMA支持多路同时读写PS或者PLDDR，演示例子中给出了2个FMDA同时访问PS DDR

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能不能把用户接口改成 只有时钟和数据。 内存起始位置参数设置。连续的AD数据输入(或者视频输入). 存满后发中断，连续获取AD数据或者视频数据到内存。  A/B part

显然可以，FDMA控制器通过了FIFO 缓存数据，数据经过FIFO不就是可以连续发送了.

这个也支持ddr3在pl端的ddr3读写吗

支持

好帖要订

请问能从PL端直接读写PS的DDR3么？测试最大带宽多少M？

可以，

10个积分啊，感觉积分不够了咋办

ZF7042 发表于 2019-11-11 10:04
请问能从PL端直接读写PS的DDR3么？测试最大带宽多少M？

ACP理论上可以达到1.4G/S