关于Miz702 ZYNQ开发板教程第十六章中用户自定义IP--ADAU1761出现问题的总结

  可能是楼主用的教程版本比较老，在进行第十六章基于AXI4总线的音频驱动的实验中出现了一些问题。楼主是初学者，在相关技术人员的帮助下解决了问题，为了帮助大家初学者少走弯路，楼主将问题及解决过程阐述如下，供大家学习：  教程从379页的16.4节开始讲用户自定义IP--ADAU1761的创建，具体创建过程教程叙述的很详细，本文不再赘述。楼主遇见的问题是创建并依教程修改完ADAU1761后，使用ADAU1761的时候发现没有自定义输入输出BCLK ,LRCLK,SDATA_I,SDATA_O。如图1所示。很多人会以为，我们在前面的教程中已经对ADAU1761_v1_0_s00_AXI.v和ADAU1761_v1_0.v进行了修改，输入输出已经添加进去了，所以就应该有新添加的输入输出管脚。其实不是这样的，我们对IP进行了修改，就需要对IP重新进行打包，相当于更新一下IP的输入输出口，而这个工作在教程中并没有写上。所以在完成教程16.5小节的基础上，我们需要对修改后的用户IP重新进行打包。具体过程如下：
  修改完ADAU1761_v1_0_s00_AXI.v和ADAU1761_v1_0.v后，点击左上角tools>>create and package IP,会出现如图2的引导框，点击next,在图3中选择默认选项（第1项），点击next，图4中再次确认IP的位置（一般不会错，不需要修改），点击next，然后点击finish完成。
  修改后查看图5中出现了我们自定义的输入输出口，至此自定义IP的重新打包完成，可接着教程16.6进行实验。
  最后一点，16.6是指重新建工程，最好不要直接在建立IP的工程中直接进行16.6的操作。具体可看附带例程。
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