PCIE的Block location
PCIE的XDMA IP核中，PCIE Block Location选择的是X0Y0，但生成的约束文件中，如下：set_property LOC GTPE2_CHANNEL_X0Y7 .gt_wrapper_i/gtp_channel.gtpe2_channel_i}]
set_property PACKAGE_PIN D9 }]
set_property PACKAGE_PIN D7 }]
set_property LOC GTPE2_CHANNEL_X0Y6 .gt_wrapper_i/gtp_channel.gtpe2_channel_i}]
set_property PACKAGE_PIN B10 }]
set_property PACKAGE_PIN B6 }]
为X0Y7和X0Y6，请问这个位置是怎样确定的？是在XDMA中随便选择一个，然后系统自动根据引脚定义分配吗？ 对于7系列FPGA PCIE的区域只能选择X0Y0，而PCIE的引脚 只要GTP GTX上都可以支持,xdc中可以直接绑定管脚或者绑定PCIE的通道位置，一般自带的例子绑定默认的通道位置。GTP GTX的分布可以查阅XILINX相关的手册ug482 也就是说如果我在.xdc中绑定了管脚，Vivado会自动按照我绑定的管脚给我分配固定唯一的对应XmYn？比如我用的工程，按照我绑定的管脚，Vivado按照器件给我分配了X0Y7和X0Y6？
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